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基于CPLD的异步ASI/SDI信号电复接光传输设备的设计
也是一个问题。信号路数越多，速率越高，越难锁定，对pcb板的排版技术要求较高。通过对各个元器件的合理放置和科学的滤除杂波等各项处理，这个问题可以得到很好的解决。硬件电路在该设计中，主要使用的是美国国家半导体公司最新推出的功能强大且性能稳定的数字视频芯片组。其中解码及串/并转换芯片选用clc011；编码及并/串转换芯片选用clc020；时钟恢复芯片选用lmh0046；自适应电缆均衡芯片选用clc014；cpld芯片采用lattice公司的lc4256v；fifo芯片采用idt公司的idt72v2105。均衡部分电路处理过程如图2所示。由图2可知单端输入的asi/sdi串行信号通过均衡电路后得到整形，转变成一组差分信号，为接下来的时钟恢复过程作好了准备。通过均衡电路以后，信号质量大大提高，输入输出信号波形比较如图3。图2 均衡部分电路处理过程图3 均衡电路波形比较时钟恢复部分电路处理过程由图4所示。通过图4可以看到，正确地设置好芯片的工作模式，由本地提供一个27m的时钟供时钟恢复芯片使用，将均衡后的高速差分信号输入到芯片中，通过芯片处理后恢复出串

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