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摘 要:介绍了一种基于复杂可编程逻辑器件（cpld）的120mhz高速a／d采集卡的设计方法。给出了这种采集卡的硬件原理电路和主要的软件设计思路。采用该设计方法设计的数据采集卡具有包括负延迟触发等多种触发方式，具有体积小，工作可靠，控制简单等特点。 关键词:高速a／d；cpld；负延迟触发；epm7128；ad9054 高速a／d采集技术已在许多领域得到愈来愈广泛的应用，本文将详细论述采用cpld技术来实现120mhz高速a／d采集卡的设计方法，该采集卡具有包括负延迟触发在内的多种触发方式，采用cpld复杂可编程逻辑器件（又称fpga）epm7128sqc100－7和ad公司的高速模数转换器（a／d）ad9054bst－135来实现。 1
程中能稳定工作，满足设计指标要求。 0 引言 信号显示卡是雷达嵌入式故障诊断系统中的重要组件，主要完成系统工作过程中采集信号的显示和诊断流程的指示，是重要的人机对话窗口的执行部件。因此，显示卡功能的好坏，直接关系到整个系统最终能否完成工作。 1 系统硬件设计与实现 如图1所示，该显示卡的硬件电路主要由输入匹配网络、模数转换单元、时钟产生电路、时序产生电路、控制信号产生模块和显示单元组成。 图1 显示卡硬件电路示意图。 输入的模拟信号经缓冲放大以后进入模数变换器ad9054，其最高采样速率为200ms/s，具有380mhz的模拟输入带宽。它有两个采集数据输出端口(port a和port b)，可以选用单端口输出或双端*替乒乓输出。a/d转换后输出的数据经两路锁存器锁存以满足后续存储器的高速写入。 如图1所示，系统时序产生控制电路产生系统时钟并协调系统各部分工作步骤，它根据a/d变换采样时钟以及a/d变换器输出接口时序的要求，产生锁存器的锁存时钟，并以适当的延迟量提供存储器的读写脉冲。时序产生电路还提供地址产生器和记录长度计数器的计数时钟。系统初始化后，a/d
一个芯片的封装形式为什么给出了多个不同参数？本人在做一个ad转换器件时用到了ad9054芯片，该芯片的封装形式中给出了多个不同参数。例如引脚宽度这一参数分别给出了0.015和0.010（单位都是inch）。不知针对此情况在确定该芯片的封装时应如何设定参数？
基本上可以用样片解决没有必要用1gsps的adc，可以使用4片250msps的adc比如ad9054等等。时钟用ad9511来产生，4个时钟依次相移90度，这样就可以实现1gsps的实时采样。fpga可用可不用，前提条件是要有个比较大的fifo，比如269等等这个话题我关注很久了……老兄有兴趣的话可以交流下，我的email:fobyellow@sohu.com
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